2001-07-01 Ben Elliston <bje@redhat.com>
* gas/m88k/allinsn.s: New file. * gas/m88k/allinsn.d: Likewise. * gas/m88k/m88k.exp: Test with allinsn.s also.
This commit is contained in:
parent
17f0ac8499
commit
013468bc3c
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@ -1,3 +1,9 @@
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2001-07-01 Ben Elliston <bje@redhat.com>
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* gas/m88k/allinsn.s: New file.
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* gas/m88k/allinsn.d: Likewise.
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* gas/m88k/m88k.exp: Test with allinsn.s also.
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2001-06-28 Eric Christopher <echristo@redhat.com>
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2001-06-28 Eric Christopher <echristo@redhat.com>
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* gas/mips/usd.d: Change for march/mtune.
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* gas/mips/usd.d: Change for march/mtune.
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@ -0,0 +1,369 @@
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#as:
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#objdump: -dr
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#name: allinsn
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.*: +file format .*
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Disassembly of section .text:
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00000000 <.text>:
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0: f4 01 70 02 add r0,r1,r2
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4: f4 22 72 03 add.ci r1,r2,r3
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8: f4 43 71 04 add.co r2,r3,r4
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c: f4 64 73 05 add.cio r3,r4,r5
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10: 70 85 00 00 add r4,r5,0
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14: 70 85 10 00 add r4,r5,0x1000
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18: f4 01 60 02 addu r0,r1,r2
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1c: f4 22 62 03 addu.ci r1,r2,r3
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20: f4 43 61 04 addu.co r2,r3,r4
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24: f4 64 63 05 addu.cio r3,r4,r5
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28: 60 85 00 00 addu r4,r5,0
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2c: 60 85 10 00 addu r4,r5,0x1000
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30: f4 01 40 02 and r0,r1,r2
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34: f4 22 44 03 and.c r1,r2,r3
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38: 40 43 00 00 and r2,r3,0
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3c: 40 43 10 00 and r2,r3,0x1000
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40: 44 43 00 00 and.u r2,r3,0
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44: 44 43 10 00 and.u r2,r3,0x1000
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48: d0 01 00 00 bb0 0,r1,48 <.text\+0x48>
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4a: PCR16L \*ABS\*
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4c: d0 01 ff fd bb0 0,r1,40 <.text\+0x40>
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4e: PCR16L \*ABS\*
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50: d0 01 00 02 bb0 0,r1,58 <.text\+0x58>
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||||||
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52: PCR16L \*ABS\*
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||||||
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54: d3 e1 00 00 bb0 0x1f,r1,54 <.text\+0x54>
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56: PCR16L \*ABS\*
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||||||
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58: d3 e1 ff fd bb0 0x1f,r1,4c <.text\+0x4c>
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||||||
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5a: PCR16L \*ABS\*
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||||||
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5c: d3 e1 00 02 bb0 0x1f,r1,64 <.text\+0x64>
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||||||
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5e: PCR16L \*ABS\*
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||||||
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60: d4 01 00 00 bb0.n 0,r1,60 <.text\+0x60>
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||||||
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62: PCR16L \*ABS\*
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||||||
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64: d8 01 00 00 bb1 0,r1,64 <.text\+0x64>
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||||||
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66: PCR16L \*ABS\*
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||||||
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68: d8 01 ff fd bb1 0,r1,5c <.text\+0x5c>
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||||||
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6a: PCR16L \*ABS\*
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||||||
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6c: d8 01 00 02 bb1 0,r1,74 <.text\+0x74>
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||||||
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6e: PCR16L \*ABS\*
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||||||
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70: db e1 00 00 bb1 0x1f,r1,70 <.text\+0x70>
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||||||
|
72: PCR16L \*ABS\*
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||||||
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74: db e1 ff fd bb1 0x1f,r1,68 <.text\+0x68>
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||||||
|
76: PCR16L \*ABS\*
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||||||
|
78: db e1 00 02 bb1 0x1f,r1,80 <.text\+0x80>
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||||||
|
7a: PCR16L \*ABS\*
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||||||
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7c: dc 01 00 00 bb1.n 0,r1,7c <.text\+0x7c>
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||||||
|
7e: PCR16L \*ABS\*
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||||||
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80: e8 41 00 00 bcnd eq0,r1,80 <.text\+0x80>
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||||||
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82: PCR16L \*ABS\*
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||||||
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84: e8 41 00 02 bcnd eq0,r1,8c <.text\+0x8c>
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||||||
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86: PCR16L \*ABS\*
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||||||
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88: e8 41 ff fd bcnd eq0,r1,7c <.text\+0x7c>
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8a: PCR16L \*ABS\*
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8c: ec 41 00 00 bcnd.n eq0,r1,8c <.text\+0x8c>
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||||||
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8e: PCR16L \*ABS\*
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||||||
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90: ec 41 00 02 bcnd.n eq0,r1,98 <.text\+0x98>
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92: PCR16L \*ABS\*
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94: ec 41 ff fd bcnd.n eq0,r1,88 <.text\+0x88>
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||||||
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96: PCR16L \*ABS\*
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98: e9 a1 00 00 bcnd ne0,r1,98 <.text\+0x98>
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9a: PCR16L \*ABS\*
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9c: e9 a1 00 02 bcnd ne0,r1,a4 <.text\+0xa4>
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9e: PCR16L \*ABS\*
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a0: e9 a1 ff fd bcnd ne0,r1,94 <.text\+0x94>
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a2: PCR16L \*ABS\*
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a4: ed a1 00 00 bcnd.n ne0,r1,a4 <.text\+0xa4>
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a6: PCR16L \*ABS\*
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a8: ed a1 00 02 bcnd.n ne0,r1,b0 <.text\+0xb0>
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aa: PCR16L \*ABS\*
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ac: ed a1 ff fd bcnd.n ne0,r1,a0 <.text\+0xa0>
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ae: PCR16L \*ABS\*
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b0: e8 21 00 00 bcnd gt0,r1,b0 <.text\+0xb0>
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b2: PCR16L \*ABS\*
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b4: e8 21 00 02 bcnd gt0,r1,bc <.text\+0xbc>
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||||||
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b6: PCR16L \*ABS\*
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b8: e8 21 ff fd bcnd gt0,r1,ac <.text\+0xac>
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ba: PCR16L \*ABS\*
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bc: ec 21 00 00 bcnd.n gt0,r1,bc <.text\+0xbc>
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be: PCR16L \*ABS\*
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c0: ec 21 00 02 bcnd.n gt0,r1,c8 <.text\+0xc8>
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c2: PCR16L \*ABS\*
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c4: ec 21 ff fd bcnd.n gt0,r1,b8 <.text\+0xb8>
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c6: PCR16L \*ABS\*
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c8: e9 81 00 00 bcnd lt0,r1,c8 <.text\+0xc8>
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ca: PCR16L \*ABS\*
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cc: e9 81 00 02 bcnd lt0,r1,d4 <.text\+0xd4>
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ce: PCR16L \*ABS\*
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d0: e9 81 ff fd bcnd lt0,r1,c4 <.text\+0xc4>
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d2: PCR16L \*ABS\*
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d4: ed 81 00 00 bcnd.n lt0,r1,d4 <.text\+0xd4>
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d6: PCR16L \*ABS\*
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d8: ed 81 00 02 bcnd.n lt0,r1,e0 <.text\+0xe0>
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da: PCR16L \*ABS\*
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dc: ed 81 ff fd bcnd.n lt0,r1,d0 <.text\+0xd0>
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de: PCR16L \*ABS\*
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e0: e8 61 00 00 bcnd ge0,r1,e0 <.text\+0xe0>
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e2: PCR16L \*ABS\*
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e4: e8 61 00 02 bcnd ge0,r1,ec <.text\+0xec>
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e6: PCR16L \*ABS\*
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e8: e8 61 ff fd bcnd ge0,r1,dc <.text\+0xdc>
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ea: PCR16L \*ABS\*
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ec: ec 61 00 00 bcnd.n ge0,r1,ec <.text\+0xec>
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ee: PCR16L \*ABS\*
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f0: ec 61 00 02 bcnd.n ge0,r1,f8 <.text\+0xf8>
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f2: PCR16L \*ABS\*
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f4: ec 61 ff fd bcnd.n ge0,r1,e8 <.text\+0xe8>
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f6: PCR16L \*ABS\*
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f8: e9 c1 00 00 bcnd le0,r1,f8 <.text\+0xf8>
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fa: PCR16L \*ABS\*
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fc: e9 c1 00 02 bcnd le0,r1,104 <.text\+0x104>
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fe: PCR16L \*ABS\*
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100: e9 c1 ff fd bcnd le0,r1,f4 <.text\+0xf4>
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||||||
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102: PCR16L \*ABS\*
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||||||
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104: ed c1 00 00 bcnd.n le0,r1,104 <.text\+0x104>
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||||||
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106: PCR16L \*ABS\*
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||||||
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108: ed c1 00 02 bcnd.n le0,r1,110 <.text\+0x110>
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||||||
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10a: PCR16L \*ABS\*
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||||||
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10c: ed c1 ff fd bcnd.n le0,r1,100 <.text\+0x100>
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||||||
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10e: PCR16L \*ABS\*
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110: e8 61 00 00 bcnd ge0,r1,110 <.text\+0x110>
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||||||
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112: PCR16L \*ABS\*
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||||||
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114: e8 61 00 02 bcnd ge0,r1,11c <.text\+0x11c>
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||||||
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116: PCR16L \*ABS\*
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||||||
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118: e8 61 ff fd bcnd ge0,r1,10c <.text\+0x10c>
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||||||
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11a: PCR16L \*ABS\*
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11c: ec 61 00 00 bcnd.n ge0,r1,11c <.text\+0x11c>
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||||||
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11e: PCR16L \*ABS\*
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||||||
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120: ec 61 00 02 bcnd.n ge0,r1,128 <.text\+0x128>
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||||||
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122: PCR16L \*ABS\*
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||||||
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124: ec 61 ff fd bcnd.n ge0,r1,118 <.text\+0x118>
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126: PCR16L \*ABS\*
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||||||
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128: c0 00 00 00 br 128 <.text\+0x128>
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||||||
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128: PCR26L \*ABS\*
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||||||
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12c: c3 ff ff fd br 120 <.text\+0x120>
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||||||
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12c: PCR26L \*ABS\*
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||||||
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130: c0 00 00 02 br 138 <.text\+0x138>
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||||||
|
130: PCR26L \*ABS\*
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||||||
|
134: c4 00 00 00 br.n 134 <.text\+0x134>
|
||||||
|
134: PCR26L \*ABS\*
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||||||
|
138: c7 ff ff fd br.n 12c <.text\+0x12c>
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||||||
|
138: PCR26L \*ABS\*
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||||||
|
13c: c4 00 00 02 br.n 144 <.text\+0x144>
|
||||||
|
13c: PCR26L \*ABS\*
|
||||||
|
140: c8 00 00 00 bsr 140 <.text\+0x140>
|
||||||
|
140: PCR26L \*ABS\*
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||||||
|
144: cb ff ff fd bsr 138 <.text\+0x138>
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||||||
|
144: PCR26L \*ABS\*
|
||||||
|
148: c8 00 00 02 bsr 150 <.text\+0x150>
|
||||||
|
148: PCR26L \*ABS\*
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||||||
|
14c: cc 00 00 00 bsr.n 14c <.text\+0x14c>
|
||||||
|
14c: PCR26L \*ABS\*
|
||||||
|
150: cf ff ff fd bsr.n 144 <.text\+0x144>
|
||||||
|
150: PCR26L \*ABS\*
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||||||
|
154: cc 00 00 02 bsr.n 15c <.text\+0x15c>
|
||||||
|
154: PCR26L \*ABS\*
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||||||
|
158: f0 22 80 af clr r1,r2,5<15>
|
||||||
|
15c: f4 22 80 03 clr r1,r2,r3
|
||||||
|
160: f0 22 80 06 clr r1,r2,0<6>
|
||||||
|
164: f0 22 80 06 clr r1,r2,0<6>
|
||||||
|
168: f4 01 7c 02 cmp r0,r1,r2
|
||||||
|
16c: 7c 02 00 00 cmp r0,r2,0
|
||||||
|
170: 7c 02 10 00 cmp r0,r2,0x1000
|
||||||
|
174: f4 01 78 02 divs r0,r1,r2
|
||||||
|
178: 78 01 00 00 divs r0,r1,0
|
||||||
|
17c: 78 01 10 00 divs r0,r1,0x1000
|
||||||
|
180: f4 01 68 02 divu r0,r1,r2
|
||||||
|
184: 68 01 00 00 divu r0,r1,0
|
||||||
|
188: 68 01 00 0a divu r0,r1,0x0a
|
||||||
|
18c: f0 01 91 45 ext r0,r1,10<5>
|
||||||
|
190: f4 22 90 03 ext r1,r2,r3
|
||||||
|
194: f0 43 90 06 ext r2,r3,0<6>
|
||||||
|
198: f0 43 90 06 ext r2,r3,0<6>
|
||||||
|
19c: f0 01 99 45 extu r0,r1,10<5>
|
||||||
|
1a0: f4 22 98 03 extu r1,r2,r3
|
||||||
|
1a4: f0 22 98 06 extu r1,r2,0<6>
|
||||||
|
1a8: f0 22 98 06 extu r1,r2,0<6>
|
||||||
|
1ac: 84 01 28 02 fadd.sss r0,r1,r2
|
||||||
|
1b0: 84 01 28 82 fadd.ssd r0,r1,r2
|
||||||
|
1b4: 84 01 2a 02 fadd.sds r0,r1,r2
|
||||||
|
1b8: 84 01 2a 82 fadd.sdd r0,r1,r2
|
||||||
|
1bc: 84 01 28 22 fadd.dss r0,r1,r2
|
||||||
|
1c0: 84 01 28 a2 fadd.dsd r0,r1,r2
|
||||||
|
1c4: 84 01 2a 22 fadd.dds r0,r1,r2
|
||||||
|
1c8: 84 01 2a a2 fadd.ddd r0,r1,r2
|
||||||
|
1cc: 84 01 38 02 fcmp.ss r0,r1,r2
|
||||||
|
1d0: 84 01 38 82 fcmp.sd r0,r1,r2
|
||||||
|
1d4: 84 01 3a 02 fcmp.ds r0,r1,r2
|
||||||
|
1d8: 84 01 3a 82 fcmp.dd r0,r1,r2
|
||||||
|
1dc: 84 01 70 02 fdiv.sss r0,r1,r2
|
||||||
|
1e0: 84 01 70 82 fdiv.ssd r0,r1,r2
|
||||||
|
1e4: 84 01 72 02 fdiv.sds r0,r1,r2
|
||||||
|
1e8: 84 01 72 82 fdiv.sdd r0,r1,r2
|
||||||
|
1ec: 84 01 70 22 fdiv.dss r0,r1,r2
|
||||||
|
1f0: 84 01 70 a2 fdiv.dsd r0,r1,r2
|
||||||
|
1f4: 84 01 72 22 fdiv.dds r0,r1,r2
|
||||||
|
1f8: 84 01 72 a2 fdiv.ddd r0,r1,r2
|
||||||
|
1fc: f4 20 ec 07 ff0 r1,r7
|
||||||
|
200: f4 60 e8 08 ff1 r3,r8
|
||||||
|
204: 80 00 4e 40 fldcr r0,fcr50
|
||||||
|
208: 84 00 20 03 flt.s r0,r3
|
||||||
|
20c: 84 00 20 2a flt.d r0,r10
|
||||||
|
210: 84 01 00 02 fmul.sss r0,r1,r2
|
||||||
|
214: 84 01 00 82 fmul.ssd r0,r1,r2
|
||||||
|
218: 84 01 02 02 fmul.sds r0,r1,r2
|
||||||
|
21c: 84 01 02 82 fmul.sdd r0,r1,r2
|
||||||
|
220: 84 01 00 22 fmul.dss r0,r1,r2
|
||||||
|
224: 84 01 00 a2 fmul.dsd r0,r1,r2
|
||||||
|
228: 84 01 02 22 fmul.dds r0,r1,r2
|
||||||
|
22c: 84 01 02 a2 fmul.ddd r0,r1,r2
|
||||||
|
230: 80 00 8e 40 fstcr r0,fcr50
|
||||||
|
234: 84 01 30 02 fsub.sss r0,r1,r2
|
||||||
|
238: 84 01 30 82 fsub.ssd r0,r1,r2
|
||||||
|
23c: 84 01 32 02 fsub.sds r0,r1,r2
|
||||||
|
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48c: f4 00 58 00 or r0,r0,r0
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@ -0,0 +1,460 @@
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;; Test all instructions in the m88k instruction set.
|
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|
;; Copyright 2001 Free Software Foundation, Inc.
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|
;; Contributed by Ben Elliston (bje at redhat.com).
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||||||
|
.text
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|
;; integer add
|
||||||
|
|
||||||
|
add r0, r1, r2
|
||||||
|
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|
||||||
|
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|
||||||
|
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|
||||||
|
add r4, r5, 0
|
||||||
|
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|
||||||
|
|
||||||
|
;; unsigned integer add
|
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|
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|
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|
||||||
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|
||||||
|
addu r4, r5, 0
|
||||||
|
addu r4, r5, 4096
|
||||||
|
|
||||||
|
;; logical and
|
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|
|
||||||
|
and r0, r1, r2
|
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|
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|
||||||
|
and r2, r3, 0
|
||||||
|
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|
||||||
|
and.u r2, r3, 0
|
||||||
|
and.u r2, r3, 4096
|
||||||
|
|
||||||
|
;; branch on bit clear
|
||||||
|
|
||||||
|
bb0 0, r1, 0
|
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|
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|
||||||
|
bb0 0, r1, 10
|
||||||
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|
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|
bb0 31, r1, -10
|
||||||
|
bb0 31, r1, 10
|
||||||
|
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|
||||||
|
|
||||||
|
;; branch on bit set
|
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|
|
||||||
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|
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|
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|
||||||
|
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|
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|
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bb1 31, r1, -10
|
||||||
|
bb1 31, r1, 10
|
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|
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|
|
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;; conditional branch
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|
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|
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|
||||||
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bcnd.n eq0, r1, -10
|
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|
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
|
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|
||||||
|
bcnd gt0, r1, -10
|
||||||
|
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|
||||||
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bcnd.n gt0, r1, 10
|
||||||
|
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|
||||||
|
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|
||||||
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bcnd lt0, r1, 10
|
||||||
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|
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|
||||||
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|
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|
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|
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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||||||
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|
||||||
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|
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|
||||||
|
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|
||||||
|
;; using m5 field
|
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|
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|
||||||
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|
||||||
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|
||||||
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|
||||||
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|
||||||
|
|
||||||
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;; uncoditional branch
|
||||||
|
|
||||||
|
br 0
|
||||||
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br -10
|
||||||
|
br 10
|
||||||
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br.n 0
|
||||||
|
br.n -10
|
||||||
|
br.n 10
|
||||||
|
|
||||||
|
;; branch to subroutine
|
||||||
|
|
||||||
|
bsr 0
|
||||||
|
bsr -10
|
||||||
|
bsr 10
|
||||||
|
bsr.n 0
|
||||||
|
bsr.n -10
|
||||||
|
bsr.n 10
|
||||||
|
|
||||||
|
;; clear bit field
|
||||||
|
|
||||||
|
clr r1, r2, 5<15>
|
||||||
|
clr r1, r2, r3
|
||||||
|
clr r1, r2, 6
|
||||||
|
clr r1, r2, <6>
|
||||||
|
|
||||||
|
;; integer compare
|
||||||
|
|
||||||
|
cmp r0, r1, r2
|
||||||
|
cmp r0, r2, 0
|
||||||
|
cmp r0, r2, 4096
|
||||||
|
|
||||||
|
;; signed integer divide
|
||||||
|
|
||||||
|
div r0, r1, r2
|
||||||
|
div r0, r1, 0
|
||||||
|
div r0, r1, 4096
|
||||||
|
|
||||||
|
;; unsigned integer divide
|
||||||
|
|
||||||
|
divu r0, r1, r2
|
||||||
|
divu r0, r1, 0
|
||||||
|
divu r0, r1, 10
|
||||||
|
|
||||||
|
;; extract signed bit field
|
||||||
|
|
||||||
|
ext r0, r1, 10<5>
|
||||||
|
ext r1, r2, r3
|
||||||
|
ext r2, r3, 6
|
||||||
|
ext r2, r3, <6>
|
||||||
|
|
||||||
|
;; extract unsigned bit field
|
||||||
|
|
||||||
|
extu r0, r1, 10<5>
|
||||||
|
extu r1, r2, r3
|
||||||
|
extu r1, r2, 6
|
||||||
|
extu r1, r2, <6>
|
||||||
|
|
||||||
|
;; floating point add
|
||||||
|
|
||||||
|
fadd.sss r0, r1, r2
|
||||||
|
fadd.ssd r0, r1, r2
|
||||||
|
fadd.sds r0, r1, r2
|
||||||
|
fadd.sdd r0, r1, r2
|
||||||
|
fadd.dss r0, r1, r2
|
||||||
|
fadd.dsd r0, r1, r2
|
||||||
|
fadd.dds r0, r1, r2
|
||||||
|
fadd.ddd r0, r1, r2
|
||||||
|
|
||||||
|
;; floating point compare
|
||||||
|
|
||||||
|
fcmp.sss r0, r1, r2
|
||||||
|
fcmp.ssd r0, r1, r2
|
||||||
|
fcmp.sds r0, r1, r2
|
||||||
|
fcmp.sdd r0, r1, r2
|
||||||
|
|
||||||
|
;; floating point divide
|
||||||
|
|
||||||
|
fdiv.sss r0, r1, r2
|
||||||
|
fdiv.ssd r0, r1, r2
|
||||||
|
fdiv.sds r0, r1, r2
|
||||||
|
fdiv.sdd r0, r1, r2
|
||||||
|
fdiv.dss r0, r1, r2
|
||||||
|
fdiv.dsd r0, r1, r2
|
||||||
|
fdiv.dds r0, r1, r2
|
||||||
|
fdiv.ddd r0, r1, r2
|
||||||
|
|
||||||
|
;; find first bit clear
|
||||||
|
|
||||||
|
ff0 r1, r7
|
||||||
|
|
||||||
|
;; find first bit set
|
||||||
|
|
||||||
|
ff1 r3, r8
|
||||||
|
|
||||||
|
;; load from floating-point control register
|
||||||
|
|
||||||
|
fldcr r0, fcr50
|
||||||
|
|
||||||
|
;; convert integer to floating point
|
||||||
|
|
||||||
|
flt.ss r0, r3
|
||||||
|
flt.ds r0, r10
|
||||||
|
|
||||||
|
;; floating point multiply
|
||||||
|
|
||||||
|
fmul.sss r0, r1, r2
|
||||||
|
fmul.ssd r0, r1, r2
|
||||||
|
fmul.sds r0, r1, r2
|
||||||
|
fmul.sdd r0, r1, r2
|
||||||
|
fmul.dss r0, r1, r2
|
||||||
|
fmul.dsd r0, r1, r2
|
||||||
|
fmul.dds r0, r1, r2
|
||||||
|
fmul.ddd r0, r1, r2
|
||||||
|
|
||||||
|
;; store to floating point control register
|
||||||
|
|
||||||
|
fstcr r0, fcr50
|
||||||
|
|
||||||
|
;; floating point subtract
|
||||||
|
|
||||||
|
fsub.sss r0, r1, r2
|
||||||
|
fsub.ssd r0, r1, r2
|
||||||
|
fsub.sds r0, r1, r2
|
||||||
|
fsub.sdd r0, r1, r2
|
||||||
|
fsub.dss r0, r1, r2
|
||||||
|
fsub.dsd r0, r1, r2
|
||||||
|
fsub.dds r0, r1, r2
|
||||||
|
fsub.ddd r0, r1, r2
|
||||||
|
|
||||||
|
;; exchange floating point control register
|
||||||
|
|
||||||
|
fxcr r0, r1, fcr50
|
||||||
|
|
||||||
|
;; round floating point to integer
|
||||||
|
|
||||||
|
int.ss r0, r1
|
||||||
|
int.sd r10, r2
|
||||||
|
|
||||||
|
;; unconditional jump
|
||||||
|
|
||||||
|
jmp r0
|
||||||
|
jmp.n r10
|
||||||
|
|
||||||
|
;; jump to subroutine
|
||||||
|
|
||||||
|
jsr r10
|
||||||
|
jsr.n r13
|
||||||
|
|
||||||
|
;; load register from memory
|
||||||
|
|
||||||
|
;; unscaled
|
||||||
|
ld.b r0, r1, 0
|
||||||
|
ld.b r0, r1, 4096
|
||||||
|
ld.bu r0, r1, 0
|
||||||
|
ld.bu r0, r1, 4096
|
||||||
|
ld.h r0, r1, 0
|
||||||
|
ld.h r0, r1, 4096
|
||||||
|
ld.hu r0, r1, 0
|
||||||
|
ld.hu r0, r1, 4096
|
||||||
|
ld r0, r1, 0
|
||||||
|
ld r0, r1, 4096
|
||||||
|
ld.d r0, r1, 0
|
||||||
|
ld.d r0, r1, 4096
|
||||||
|
;; unscaled
|
||||||
|
ld.b r0, r1, r2
|
||||||
|
ld.bu r1, r2, r3
|
||||||
|
ld.h r2, r3, r4
|
||||||
|
ld.hu r3, r4, r5
|
||||||
|
ld r4, r5, r6
|
||||||
|
ld.d r5, r6, r7
|
||||||
|
ld.b.usr r6, r7, r8
|
||||||
|
ld.bu.usr r7, r8, r9
|
||||||
|
ld.h.usr r8, r9, r1
|
||||||
|
ld.hu.usr r9, r1, r2
|
||||||
|
ld.usr r1, r2, r3
|
||||||
|
ld.d.usr r2, r3, r4
|
||||||
|
;; scaled
|
||||||
|
ld.b r0, r1[r2]
|
||||||
|
ld.bu r1, r2[r3]
|
||||||
|
ld.h r2, r3[r4]
|
||||||
|
ld.hu r3, r4[r5]
|
||||||
|
ld r4, r5[r6]
|
||||||
|
ld.d r5, r6[r7]
|
||||||
|
ld.b.usr r6, r7[r8]
|
||||||
|
ld.bu.usr r7, r8[r9]
|
||||||
|
ld.h.usr r8, r9[r1]
|
||||||
|
ld.hu.usr r9, r1[r2]
|
||||||
|
ld.usr r1, r2[r3]
|
||||||
|
ld.d.usr r2, r3[r4]
|
||||||
|
|
||||||
|
;; load address
|
||||||
|
|
||||||
|
lda.h r0, r1[r2]
|
||||||
|
lda r1,r2[r3]
|
||||||
|
lda.d r2,r3[r4]
|
||||||
|
|
||||||
|
;; load from control register
|
||||||
|
|
||||||
|
ldcr r0, cr10
|
||||||
|
|
||||||
|
;; make bit field
|
||||||
|
|
||||||
|
mak r0, r1, 10<5>
|
||||||
|
mak r0, r1, r2
|
||||||
|
mak r0, r1, 6
|
||||||
|
mak r0, r1, <6>
|
||||||
|
|
||||||
|
;; logical mask immediate
|
||||||
|
|
||||||
|
mask r0, r1, 0
|
||||||
|
mask r0, r1, 4096
|
||||||
|
mask.u r0, r1, 0
|
||||||
|
mask.u r0, r1, 4096
|
||||||
|
|
||||||
|
;; integer multiply
|
||||||
|
|
||||||
|
mul r0, r1, r2
|
||||||
|
mul r0, r1, 0
|
||||||
|
mul r0, r1, 4096
|
||||||
|
|
||||||
|
;; floating point round to nearest integer
|
||||||
|
|
||||||
|
nint.ss r0, r10
|
||||||
|
nint.sd r10, r12
|
||||||
|
|
||||||
|
;; logical or
|
||||||
|
|
||||||
|
or r0, r1, r2
|
||||||
|
or.c r1, r7, r10
|
||||||
|
or r0, r4, 0
|
||||||
|
or r0, r4, 4096
|
||||||
|
or.u r0, r1, 0
|
||||||
|
or.u r2, r4, 4096
|
||||||
|
|
||||||
|
;; rotate register
|
||||||
|
|
||||||
|
rot r0, r1,<5>
|
||||||
|
rot r2, r4, r6
|
||||||
|
|
||||||
|
;; return from exception
|
||||||
|
|
||||||
|
rte
|
||||||
|
|
||||||
|
;; set bit field
|
||||||
|
|
||||||
|
set r0, r1, 10<5>
|
||||||
|
set r2, r4, r6
|
||||||
|
set r3, r7, 6
|
||||||
|
set r3, r7, <6>
|
||||||
|
|
||||||
|
;; store register to memory
|
||||||
|
|
||||||
|
;; unscaled
|
||||||
|
st.b r0, r1, 0
|
||||||
|
st.b r0, r1, 4096
|
||||||
|
st.h r0, r1, 0
|
||||||
|
st.h r0, r1, 4096
|
||||||
|
st r0, r1, 0
|
||||||
|
st r0, r1, 4096
|
||||||
|
st.d r0, r1, 0
|
||||||
|
st.d r0, r1, 4096
|
||||||
|
;; unscaled
|
||||||
|
st.b r0, r1, r2
|
||||||
|
st.h r2, r3, r4
|
||||||
|
st r4, r5, r6
|
||||||
|
st.d r5, r6, r7
|
||||||
|
st.b.usr r6, r7, r8
|
||||||
|
st.h.usr r8, r9, r1
|
||||||
|
st.usr r1, r2, r3
|
||||||
|
st.d.usr r2, r3, r4
|
||||||
|
;; scaled
|
||||||
|
st.b r0, r1[r2]
|
||||||
|
st.h r2, r3[r4]
|
||||||
|
st r4, r5[r6]
|
||||||
|
st.d r5, r6[r7]
|
||||||
|
st.b.usr r6, r7[r8]
|
||||||
|
st.h.usr r8, r9[r1]
|
||||||
|
st.usr r1, r2[r3]
|
||||||
|
st.d.usr r2, r3[r4]
|
||||||
|
|
||||||
|
;; store to control register
|
||||||
|
|
||||||
|
stcr r0, cr10
|
||||||
|
|
||||||
|
;; integer subtract
|
||||||
|
|
||||||
|
sub r0, r1, r2
|
||||||
|
sub.ci r1, r2, r3
|
||||||
|
sub.co r2, r3, r4
|
||||||
|
sub.cio r3, r4, r5
|
||||||
|
sub r4, r5, 0
|
||||||
|
sub r4, r5, 4096
|
||||||
|
|
||||||
|
;; unsigned integer subtract
|
||||||
|
|
||||||
|
subu r0, r1, r2
|
||||||
|
subu.ci r1, r2, r3
|
||||||
|
subu.co r3, r4, r5
|
||||||
|
subu.cio r4, r5, r6
|
||||||
|
subu r5, r6, 0
|
||||||
|
subu r5, r6, 4096
|
||||||
|
|
||||||
|
;; trap on bit clear
|
||||||
|
|
||||||
|
tb0 0, r10, 10
|
||||||
|
tb0 31, r11, 10
|
||||||
|
|
||||||
|
;; trap on bit set
|
||||||
|
|
||||||
|
tb1 0, r10, 10
|
||||||
|
tb1 31, r11, 10
|
||||||
|
|
||||||
|
;; trap on bounds check
|
||||||
|
|
||||||
|
tbnd r0, r1
|
||||||
|
tbnd r7, 0
|
||||||
|
tbnd r7, 4096
|
||||||
|
|
||||||
|
;; conditional trap
|
||||||
|
|
||||||
|
tcnd eq0, r10, 12
|
||||||
|
tcnd ne0, r9, 12
|
||||||
|
tcnd gt0, r8, 7
|
||||||
|
tcnd lt0, r7, 1
|
||||||
|
tcnd ge0, r6, 35
|
||||||
|
tcnd le0, r5, 33
|
||||||
|
tcnd 10, r4, 12
|
||||||
|
|
||||||
|
;; truncate floating point to integer
|
||||||
|
|
||||||
|
trnc.ss r0, r1
|
||||||
|
trnc.sd r1, r3
|
||||||
|
|
||||||
|
;; exchange control register
|
||||||
|
|
||||||
|
xcr r0, r3, cr10
|
||||||
|
|
||||||
|
;; exchange register with memory
|
||||||
|
|
||||||
|
;; FIXME: these should assemble!
|
||||||
|
;; xmem.bu r0, r1, 0
|
||||||
|
;; xmem.bu r0, r1, 10
|
||||||
|
;; xmem r0, r1, 0
|
||||||
|
;; xmem r1, r2, 4096
|
||||||
|
xmem.bu r0, r1, r2
|
||||||
|
xmem r1, r2, r3
|
||||||
|
xmem.bu.usr r4, r5, r6
|
||||||
|
xmem.usr r5, r6, r7
|
||||||
|
xmem.bu r2, r3[r4]
|
||||||
|
xmem r3, r4[r5]
|
||||||
|
xmem.bu.usr r4, r5[r9]
|
||||||
|
xmem.usr r5, r6[r10]
|
||||||
|
|
||||||
|
;; logical exclusive or
|
||||||
|
|
||||||
|
xor r0, r1, r2
|
||||||
|
xor.c r1, r2, r3
|
||||||
|
xor r2, r3, 0
|
||||||
|
xor r2, r4, 4096
|
||||||
|
xor.u r1, r2, 0
|
||||||
|
xor.u r2, r3, 4096
|
||||||
|
|
|
@ -1,10 +1,26 @@
|
||||||
|
# Copyright 2001 Free Software Foundation, Inc.
|
||||||
|
|
||||||
|
# This program is free software; you can redistribute it and/or modify
|
||||||
|
# it under the terms of the GNU General Public License as published by
|
||||||
|
# the Free Software Foundation; either version 2 of the License, or
|
||||||
|
# (at your option) any later version.
|
||||||
#
|
#
|
||||||
|
# This program is distributed in the hope that it will be useful,
|
||||||
|
# but WITHOUT ANY WARRANTY; without even the implied warranty of
|
||||||
|
# MERCHANTABILITY or FITNESS FOR A PARTICULAR PURPOSE. See the
|
||||||
|
# GNU General Public License for more details.
|
||||||
|
#
|
||||||
|
# You should have received a copy of the GNU General Public License
|
||||||
|
# along with this program; if not, write to the Free Software
|
||||||
|
# Foundation, Inc., 59 Temple Place - Suite 330, Boston, MA 02111-1307, USA.
|
||||||
|
|
||||||
# Tests for m88k svr3 targets
|
# Tests for m88k svr3 targets
|
||||||
#
|
|
||||||
if { [istarget m88*-*-sysv3] || [istarget m88*-*-coff* ] } then {
|
if { [istarget m88*-*-sysv3] || [istarget m88*-*-coff* ] } then {
|
||||||
set testname "Proper padding of .init section"
|
set testname "Proper padding of .init section"
|
||||||
run_dump_test init
|
run_dump_test init
|
||||||
|
set testname "All m88k instructions assemble and disassemble"
|
||||||
|
run_dump_test allinsn
|
||||||
}
|
}
|
||||||
if [info exists errorInfo] then {
|
|
||||||
unset errorInfo
|
if [info exists errorInfo] then { unset errorInfo }
|
||||||
}
|
|
||||||
|
|
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