Revert "serial/8250: Add support for NI-Serial PXI/PXIe+485 devices"
This reverts commitfdc2de8712
("serial/8250: Add support for NI-Serial PXI/PXIe+485 devices"). The commitfdc2de8712
("serial/8250: Add support for NI-Serial PXI/PXIe+485 devices") introduced a breakage on NI-Serial PXI(e)-RS485 devices, RS-232 variants have no issue. The Linux system can enumerate the NI-Serial PXI(e)-RS485 devices, but it broke the R/W operation on the ports. However, the implementation is working on the NI internal Linux RT kernel but it does not work in the Linux main tree kernel. This is only affecting NI products, specifically the RS-485 variants. Reverting the upstream until a proper implementation that can apply to both NI internal Linux kernel and Linux mainline kernel is figured out. Signed-off-by: Je Yen Tam <je.yen.tam@ni.com> Fixes:fdc2de8712
("serial/8250: Add support for NI-Serial PXI/PXIe+485 devices") Cc: stable <stable@vger.kernel.org> Link: https://lore.kernel.org/r/20191127075301.9866-1-je.yen.tam@ni.com Signed-off-by: Greg Kroah-Hartman <gregkh@linuxfoundation.org>
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0c9acb1af7
commit
27ed14d0ec
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@ -745,16 +745,8 @@ static int pci_ni8430_init(struct pci_dev *dev)
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}
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}
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||||||
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||||||
/* UART Port Control Register */
|
/* UART Port Control Register */
|
||||||
#define NI16550_PCR_OFFSET 0x0f
|
#define NI8430_PORTCON 0x0f
|
||||||
#define NI16550_PCR_RS422 0x00
|
#define NI8430_PORTCON_TXVR_ENABLE (1 << 3)
|
||||||
#define NI16550_PCR_ECHO_RS485 0x01
|
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||||||
#define NI16550_PCR_DTR_RS485 0x02
|
|
||||||
#define NI16550_PCR_AUTO_RS485 0x03
|
|
||||||
#define NI16550_PCR_WIRE_MODE_MASK 0x03
|
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||||||
#define NI16550_PCR_TXVR_ENABLE_BIT BIT(3)
|
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||||||
#define NI16550_PCR_RS485_TERMINATION_BIT BIT(6)
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||||||
#define NI16550_ACR_DTR_AUTO_DTR (0x2 << 3)
|
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||||||
#define NI16550_ACR_DTR_MANUAL_DTR (0x0 << 3)
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||||||
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||||||
static int
|
static int
|
||||||
pci_ni8430_setup(struct serial_private *priv,
|
pci_ni8430_setup(struct serial_private *priv,
|
||||||
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@ -776,117 +768,14 @@ pci_ni8430_setup(struct serial_private *priv,
|
||||||
return -ENOMEM;
|
return -ENOMEM;
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||||||
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||||||
/* enable the transceiver */
|
/* enable the transceiver */
|
||||||
writeb(readb(p + offset + NI16550_PCR_OFFSET) | NI16550_PCR_TXVR_ENABLE_BIT,
|
writeb(readb(p + offset + NI8430_PORTCON) | NI8430_PORTCON_TXVR_ENABLE,
|
||||||
p + offset + NI16550_PCR_OFFSET);
|
p + offset + NI8430_PORTCON);
|
||||||
|
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||||||
iounmap(p);
|
iounmap(p);
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||||||
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||||||
return setup_port(priv, port, bar, offset, board->reg_shift);
|
return setup_port(priv, port, bar, offset, board->reg_shift);
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}
|
}
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||||||
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||||||
static int pci_ni8431_config_rs485(struct uart_port *port,
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struct serial_rs485 *rs485)
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||||||
{
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u8 pcr, acr;
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struct uart_8250_port *up;
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up = container_of(port, struct uart_8250_port, port);
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||||||
acr = up->acr;
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||||||
pcr = port->serial_in(port, NI16550_PCR_OFFSET);
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||||||
pcr &= ~NI16550_PCR_WIRE_MODE_MASK;
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||||||
if (rs485->flags & SER_RS485_ENABLED) {
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/* RS-485 */
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||||||
if ((rs485->flags & SER_RS485_RX_DURING_TX) &&
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||||||
(rs485->flags & SER_RS485_RTS_ON_SEND)) {
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dev_dbg(port->dev, "Invalid 2-wire mode\n");
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return -EINVAL;
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}
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||||||
if (rs485->flags & SER_RS485_RX_DURING_TX) {
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/* Echo */
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||||||
dev_vdbg(port->dev, "2-wire DTR with echo\n");
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||||||
pcr |= NI16550_PCR_ECHO_RS485;
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||||||
acr |= NI16550_ACR_DTR_MANUAL_DTR;
|
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||||||
} else {
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||||||
/* Auto or DTR */
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||||||
if (rs485->flags & SER_RS485_RTS_ON_SEND) {
|
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||||||
/* Auto */
|
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||||||
dev_vdbg(port->dev, "2-wire Auto\n");
|
|
||||||
pcr |= NI16550_PCR_AUTO_RS485;
|
|
||||||
acr |= NI16550_ACR_DTR_AUTO_DTR;
|
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||||||
} else {
|
|
||||||
/* DTR-controlled */
|
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||||||
/* No Echo */
|
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||||||
dev_vdbg(port->dev, "2-wire DTR no echo\n");
|
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||||||
pcr |= NI16550_PCR_DTR_RS485;
|
|
||||||
acr |= NI16550_ACR_DTR_MANUAL_DTR;
|
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||||||
}
|
|
||||||
}
|
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||||||
} else {
|
|
||||||
/* RS-422 */
|
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||||||
dev_vdbg(port->dev, "4-wire\n");
|
|
||||||
pcr |= NI16550_PCR_RS422;
|
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||||||
acr |= NI16550_ACR_DTR_MANUAL_DTR;
|
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||||||
}
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||||||
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||||||
dev_dbg(port->dev, "write pcr: 0x%08x\n", pcr);
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port->serial_out(port, NI16550_PCR_OFFSET, pcr);
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||||||
up->acr = acr;
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||||||
port->serial_out(port, UART_SCR, UART_ACR);
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||||||
port->serial_out(port, UART_ICR, up->acr);
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||||||
/* Update the cache. */
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||||||
port->rs485 = *rs485;
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return 0;
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}
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||||||
static int pci_ni8431_setup(struct serial_private *priv,
|
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const struct pciserial_board *board,
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||||||
struct uart_8250_port *uart, int idx)
|
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||||||
{
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u8 pcr, acr;
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struct pci_dev *dev = priv->dev;
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void __iomem *addr;
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unsigned int bar, offset = board->first_offset;
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||||||
if (idx >= board->num_ports)
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return 1;
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bar = FL_GET_BASE(board->flags);
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offset += idx * board->uart_offset;
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addr = pci_ioremap_bar(dev, bar);
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||||||
if (!addr)
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||||||
return -ENOMEM;
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||||||
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||||||
/* enable the transceiver */
|
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||||||
writeb(readb(addr + NI16550_PCR_OFFSET) | NI16550_PCR_TXVR_ENABLE_BIT,
|
|
||||||
addr + NI16550_PCR_OFFSET);
|
|
||||||
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||||||
pcr = readb(addr + NI16550_PCR_OFFSET);
|
|
||||||
pcr &= ~NI16550_PCR_WIRE_MODE_MASK;
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||||||
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||||||
/* set wire mode to default RS-422 */
|
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||||||
pcr |= NI16550_PCR_RS422;
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||||||
acr = NI16550_ACR_DTR_MANUAL_DTR;
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||||||
|
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||||||
/* write port configuration to register */
|
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||||||
writeb(pcr, addr + NI16550_PCR_OFFSET);
|
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||||||
|
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||||||
/* access and write to UART acr register */
|
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||||||
writeb(UART_ACR, addr + UART_SCR);
|
|
||||||
writeb(acr, addr + UART_ICR);
|
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||||||
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||||||
uart->port.rs485_config = &pci_ni8431_config_rs485;
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||||||
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||||||
iounmap(addr);
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||||||
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||||||
return setup_port(priv, uart, bar, offset, board->reg_shift);
|
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||||||
}
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||||||
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||||||
static int pci_netmos_9900_setup(struct serial_private *priv,
|
static int pci_netmos_9900_setup(struct serial_private *priv,
|
||||||
const struct pciserial_board *board,
|
const struct pciserial_board *board,
|
||||||
struct uart_8250_port *port, int idx)
|
struct uart_8250_port *port, int idx)
|
||||||
|
@ -2023,15 +1912,6 @@ pci_moxa_setup(struct serial_private *priv,
|
||||||
#define PCI_DEVICE_ID_ACCESIO_PCIE_COM_8SM 0x10E9
|
#define PCI_DEVICE_ID_ACCESIO_PCIE_COM_8SM 0x10E9
|
||||||
#define PCI_DEVICE_ID_ACCESIO_PCIE_ICM_4SM 0x11D8
|
#define PCI_DEVICE_ID_ACCESIO_PCIE_ICM_4SM 0x11D8
|
||||||
|
|
||||||
#define PCIE_DEVICE_ID_NI_PXIE8430_2328 0x74C2
|
|
||||||
#define PCIE_DEVICE_ID_NI_PXIE8430_23216 0x74C1
|
|
||||||
#define PCI_DEVICE_ID_NI_PXI8431_4852 0x7081
|
|
||||||
#define PCI_DEVICE_ID_NI_PXI8431_4854 0x70DE
|
|
||||||
#define PCI_DEVICE_ID_NI_PXI8431_4858 0x70E3
|
|
||||||
#define PCI_DEVICE_ID_NI_PXI8433_4852 0x70E9
|
|
||||||
#define PCI_DEVICE_ID_NI_PXI8433_4854 0x70ED
|
|
||||||
#define PCIE_DEVICE_ID_NI_PXIE8431_4858 0x74C4
|
|
||||||
#define PCIE_DEVICE_ID_NI_PXIE8431_48516 0x74C3
|
|
||||||
|
|
||||||
#define PCI_DEVICE_ID_MOXA_CP102E 0x1024
|
#define PCI_DEVICE_ID_MOXA_CP102E 0x1024
|
||||||
#define PCI_DEVICE_ID_MOXA_CP102EL 0x1025
|
#define PCI_DEVICE_ID_MOXA_CP102EL 0x1025
|
||||||
|
@ -2269,87 +2149,6 @@ static struct pci_serial_quirk pci_serial_quirks[] __refdata = {
|
||||||
.setup = pci_ni8430_setup,
|
.setup = pci_ni8430_setup,
|
||||||
.exit = pci_ni8430_exit,
|
.exit = pci_ni8430_exit,
|
||||||
},
|
},
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCIE_DEVICE_ID_NI_PXIE8430_2328,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8430_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCIE_DEVICE_ID_NI_PXIE8430_23216,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8430_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCI_DEVICE_ID_NI_PXI8431_4852,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCI_DEVICE_ID_NI_PXI8431_4854,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCI_DEVICE_ID_NI_PXI8431_4858,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCI_DEVICE_ID_NI_PXI8433_4852,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCI_DEVICE_ID_NI_PXI8433_4854,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCIE_DEVICE_ID_NI_PXIE8431_4858,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
{
|
|
||||||
.vendor = PCI_VENDOR_ID_NI,
|
|
||||||
.device = PCIE_DEVICE_ID_NI_PXIE8431_48516,
|
|
||||||
.subvendor = PCI_ANY_ID,
|
|
||||||
.subdevice = PCI_ANY_ID,
|
|
||||||
.init = pci_ni8430_init,
|
|
||||||
.setup = pci_ni8431_setup,
|
|
||||||
.exit = pci_ni8430_exit,
|
|
||||||
},
|
|
||||||
/* Quatech */
|
/* Quatech */
|
||||||
{
|
{
|
||||||
.vendor = PCI_VENDOR_ID_QUATECH,
|
.vendor = PCI_VENDOR_ID_QUATECH,
|
||||||
|
@ -3106,13 +2905,6 @@ enum pci_board_num_t {
|
||||||
pbn_ni8430_4,
|
pbn_ni8430_4,
|
||||||
pbn_ni8430_8,
|
pbn_ni8430_8,
|
||||||
pbn_ni8430_16,
|
pbn_ni8430_16,
|
||||||
pbn_ni8430_pxie_8,
|
|
||||||
pbn_ni8430_pxie_16,
|
|
||||||
pbn_ni8431_2,
|
|
||||||
pbn_ni8431_4,
|
|
||||||
pbn_ni8431_8,
|
|
||||||
pbn_ni8431_pxie_8,
|
|
||||||
pbn_ni8431_pxie_16,
|
|
||||||
pbn_ADDIDATA_PCIe_1_3906250,
|
pbn_ADDIDATA_PCIe_1_3906250,
|
||||||
pbn_ADDIDATA_PCIe_2_3906250,
|
pbn_ADDIDATA_PCIe_2_3906250,
|
||||||
pbn_ADDIDATA_PCIe_4_3906250,
|
pbn_ADDIDATA_PCIe_4_3906250,
|
||||||
|
@ -3765,55 +3557,6 @@ static struct pciserial_board pci_boards[] = {
|
||||||
.uart_offset = 0x10,
|
.uart_offset = 0x10,
|
||||||
.first_offset = 0x800,
|
.first_offset = 0x800,
|
||||||
},
|
},
|
||||||
[pbn_ni8430_pxie_16] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 16,
|
|
||||||
.base_baud = 3125000,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8430_pxie_8] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 8,
|
|
||||||
.base_baud = 3125000,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8431_8] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 8,
|
|
||||||
.base_baud = 3686400,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8431_4] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 4,
|
|
||||||
.base_baud = 3686400,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8431_2] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 2,
|
|
||||||
.base_baud = 3686400,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8431_pxie_16] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 16,
|
|
||||||
.base_baud = 3125000,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
[pbn_ni8431_pxie_8] = {
|
|
||||||
.flags = FL_BASE0,
|
|
||||||
.num_ports = 8,
|
|
||||||
.base_baud = 3125000,
|
|
||||||
.uart_offset = 0x10,
|
|
||||||
.first_offset = 0x800,
|
|
||||||
},
|
|
||||||
/*
|
/*
|
||||||
* ADDI-DATA GmbH PCI-Express communication cards <info@addi-data.com>
|
* ADDI-DATA GmbH PCI-Express communication cards <info@addi-data.com>
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@ -5567,33 +5310,6 @@ static const struct pci_device_id serial_pci_tbl[] = {
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* MOXA
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* MOXA
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