[MIPS] IP22: Fix broken EISA interrupt setup by switching to generic i8259
Signed-off-by: Thomas Bogendoerfer <tsbogend@alpha.franken.de> Signed-off-by: Ralf Baechle <ralf@linux-mips.org>
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cce335ae47
commit
68de480372
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@ -401,6 +401,7 @@ config SGI_IP22
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select DMA_NONCOHERENT
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select DMA_NONCOHERENT
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select HW_HAS_EISA
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select HW_HAS_EISA
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select I8253
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select I8253
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select I8259
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select IP22_CPU_SCACHE
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select IP22_CPU_SCACHE
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select IRQ_CPU
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select IRQ_CPU
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select GENERIC_ISA_DMA_SUPPORT_BROKEN
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select GENERIC_ISA_DMA_SUPPORT_BROKEN
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@ -36,6 +36,7 @@
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#include <asm/sgi/ioc.h>
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#include <asm/sgi/ioc.h>
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#include <asm/sgi/mc.h>
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#include <asm/sgi/mc.h>
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#include <asm/sgi/ip22.h>
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#include <asm/sgi/ip22.h>
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#include <asm/i8259.h>
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/* I2 has four EISA slots. */
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/* I2 has four EISA slots. */
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#define IP22_EISA_MAX_SLOTS 4
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#define IP22_EISA_MAX_SLOTS 4
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@ -93,126 +94,11 @@ static irqreturn_t ip22_eisa_intr(int irq, void *dev_id)
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return IRQ_NONE;
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return IRQ_NONE;
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}
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}
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static void enable_eisa1_irq(unsigned int irq)
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{
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u8 mask;
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mask = inb(EISA_INT1_MASK);
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mask &= ~((u8) (1 << irq));
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outb(mask, EISA_INT1_MASK);
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}
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static unsigned int startup_eisa1_irq(unsigned int irq)
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{
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u8 edge;
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/* Only use edge interrupts for EISA */
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edge = inb(EISA_INT1_EDGE_LEVEL);
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edge &= ~((u8) (1 << irq));
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outb(edge, EISA_INT1_EDGE_LEVEL);
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enable_eisa1_irq(irq);
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return 0;
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}
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static void disable_eisa1_irq(unsigned int irq)
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{
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u8 mask;
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mask = inb(EISA_INT1_MASK);
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mask |= ((u8) (1 << irq));
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outb(mask, EISA_INT1_MASK);
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}
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static void mask_and_ack_eisa1_irq(unsigned int irq)
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{
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disable_eisa1_irq(irq);
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outb(0x20, EISA_INT1_CTRL);
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}
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static void end_eisa1_irq(unsigned int irq)
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{
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if (!(irq_desc[irq].status & (IRQ_DISABLED | IRQ_INPROGRESS)))
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enable_eisa1_irq(irq);
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}
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static struct irq_chip ip22_eisa1_irq_type = {
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.name = "IP22 EISA",
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.startup = startup_eisa1_irq,
|
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||||||
.ack = mask_and_ack_eisa1_irq,
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||||||
.mask = disable_eisa1_irq,
|
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||||||
.mask_ack = mask_and_ack_eisa1_irq,
|
|
||||||
.unmask = enable_eisa1_irq,
|
|
||||||
.end = end_eisa1_irq,
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||||||
};
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static void enable_eisa2_irq(unsigned int irq)
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{
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u8 mask;
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mask = inb(EISA_INT2_MASK);
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mask &= ~((u8) (1 << (irq - 8)));
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outb(mask, EISA_INT2_MASK);
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}
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static unsigned int startup_eisa2_irq(unsigned int irq)
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{
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u8 edge;
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/* Only use edge interrupts for EISA */
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edge = inb(EISA_INT2_EDGE_LEVEL);
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edge &= ~((u8) (1 << (irq - 8)));
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outb(edge, EISA_INT2_EDGE_LEVEL);
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enable_eisa2_irq(irq);
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return 0;
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}
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static void disable_eisa2_irq(unsigned int irq)
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{
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u8 mask;
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||||||
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mask = inb(EISA_INT2_MASK);
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mask |= ((u8) (1 << (irq - 8)));
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outb(mask, EISA_INT2_MASK);
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}
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static void mask_and_ack_eisa2_irq(unsigned int irq)
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{
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disable_eisa2_irq(irq);
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outb(0x20, EISA_INT2_CTRL);
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}
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static void end_eisa2_irq(unsigned int irq)
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{
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if (!(irq_desc[irq].status & (IRQ_DISABLED | IRQ_INPROGRESS)))
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||||||
enable_eisa2_irq(irq);
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||||||
}
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static struct irq_chip ip22_eisa2_irq_type = {
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||||||
.name = "IP22 EISA",
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||||||
.startup = startup_eisa2_irq,
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||||||
.ack = mask_and_ack_eisa2_irq,
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||||||
.mask = disable_eisa2_irq,
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||||||
.mask_ack = mask_and_ack_eisa2_irq,
|
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||||||
.unmask = enable_eisa2_irq,
|
|
||||||
.end = end_eisa2_irq,
|
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||||||
};
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||||||
static struct irqaction eisa_action = {
|
static struct irqaction eisa_action = {
|
||||||
.handler = ip22_eisa_intr,
|
.handler = ip22_eisa_intr,
|
||||||
.name = "EISA",
|
.name = "EISA",
|
||||||
};
|
};
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||||||
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||||||
static struct irqaction cascade_action = {
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||||||
.handler = no_action,
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||||||
.name = "EISA cascade",
|
|
||||||
};
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int __init ip22_eisa_init(void)
|
int __init ip22_eisa_init(void)
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||||||
{
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{
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int i, c;
|
int i, c;
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||||||
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@ -248,29 +134,13 @@ int __init ip22_eisa_init(void)
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outb(1, EISA_EXT_NMI_RESET_CTRL);
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outb(1, EISA_EXT_NMI_RESET_CTRL);
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||||||
udelay(50); /* Wait long enough for the dust to settle */
|
udelay(50); /* Wait long enough for the dust to settle */
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||||||
outb(0, EISA_EXT_NMI_RESET_CTRL);
|
outb(0, EISA_EXT_NMI_RESET_CTRL);
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||||||
outb(0x11, EISA_INT1_CTRL);
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||||||
outb(0x11, EISA_INT2_CTRL);
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||||||
outb(0, EISA_INT1_MASK);
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||||||
outb(8, EISA_INT2_MASK);
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||||||
outb(4, EISA_INT1_MASK);
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||||||
outb(2, EISA_INT2_MASK);
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||||||
outb(1, EISA_INT1_MASK);
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||||||
outb(1, EISA_INT2_MASK);
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outb(0xfb, EISA_INT1_MASK);
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||||||
outb(0xff, EISA_INT2_MASK);
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||||||
outb(0, EISA_DMA2_WRITE_SINGLE);
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outb(0, EISA_DMA2_WRITE_SINGLE);
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for (i = SGINT_EISA; i < (SGINT_EISA + EISA_MAX_IRQ); i++) {
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init_i8259_irqs();
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if (i < (SGINT_EISA + 8))
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set_irq_chip(i, &ip22_eisa1_irq_type);
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||||||
else
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set_irq_chip(i, &ip22_eisa2_irq_type);
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}
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||||||
/* Cannot use request_irq because of kmalloc not being ready at such
|
/* Cannot use request_irq because of kmalloc not being ready at such
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||||||
* an early stage. Yes, I've been bitten... */
|
* an early stage. Yes, I've been bitten... */
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||||||
setup_irq(SGI_EISA_IRQ, &eisa_action);
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setup_irq(SGI_EISA_IRQ, &eisa_action);
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setup_irq(SGINT_EISA + 2, &cascade_action);
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EISA_bus = 1;
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EISA_bus = 1;
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return 0;
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return 0;
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||||||
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