vfio/pci: Intel IGD host and LCP bridge config space access
Provide read-only access to PCI config space of the PCI host bridge and LPC bridge through device specific regions. This may be used to configure a VM with matching register contents to satisfy driver requirements. Providing this through the vfio file descriptor removes an additional userspace requirement for access through pci-sysfs and removes the CAP_SYS_ADMIN requirement that doesn't appear to apply to the specific devices we're accessing. Signed-off-by: Alex Williamson <alex.williamson@redhat.com>
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f572a960a1
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@ -111,6 +111,7 @@ static inline bool vfio_pci_is_vga(struct pci_dev *pdev)
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}
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static void vfio_pci_try_bus_reset(struct vfio_pci_device *vdev);
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static void vfio_pci_disable(struct vfio_pci_device *vdev);
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static int vfio_pci_enable(struct vfio_pci_device *vdev)
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{
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@ -170,10 +171,16 @@ static int vfio_pci_enable(struct vfio_pci_device *vdev)
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vdev->has_vga = true;
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if (vfio_pci_is_vga(pdev) && pdev->vendor == PCI_VENDOR_ID_INTEL) {
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if (vfio_pci_igd_opregion_init(vdev) == 0)
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dev_info(&pdev->dev,
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"Intel IGD OpRegion support enabled\n");
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if (vfio_pci_is_vga(pdev) &&
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pdev->vendor == PCI_VENDOR_ID_INTEL &&
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IS_ENABLED(CONFIG_VFIO_PCI_IGD)) {
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ret = vfio_pci_igd_init(vdev);
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if (ret) {
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dev_warn(&vdev->pdev->dev,
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"Failed to setup Intel IGD regions\n");
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vfio_pci_disable(vdev);
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return ret;
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}
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}
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return 0;
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@ -55,7 +55,7 @@ static const struct vfio_pci_regops vfio_pci_igd_regops = {
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.release = vfio_pci_igd_release,
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};
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int vfio_pci_igd_opregion_init(struct vfio_pci_device *vdev)
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static int vfio_pci_igd_opregion_init(struct vfio_pci_device *vdev)
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{
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__le32 *dwordp = (__le32 *)(vdev->vconfig + OPREGION_PCI_ADDR);
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u32 addr, size;
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@ -109,3 +109,172 @@ int vfio_pci_igd_opregion_init(struct vfio_pci_device *vdev)
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return ret;
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}
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static size_t vfio_pci_igd_cfg_rw(struct vfio_pci_device *vdev,
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char __user *buf, size_t count, loff_t *ppos,
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bool iswrite)
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{
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unsigned int i = VFIO_PCI_OFFSET_TO_INDEX(*ppos) - VFIO_PCI_NUM_REGIONS;
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struct pci_dev *pdev = vdev->region[i].data;
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loff_t pos = *ppos & VFIO_PCI_OFFSET_MASK;
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size_t size;
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int ret;
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if (pos >= vdev->region[i].size || iswrite)
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return -EINVAL;
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size = count = min(count, (size_t)(vdev->region[i].size - pos));
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if ((pos & 1) && size) {
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u8 val;
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ret = pci_user_read_config_byte(pdev, pos, &val);
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if (ret)
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return pcibios_err_to_errno(ret);
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if (copy_to_user(buf + count - size, &val, 1))
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return -EFAULT;
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pos++;
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size--;
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}
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if ((pos & 3) && size > 2) {
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u16 val;
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ret = pci_user_read_config_word(pdev, pos, &val);
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if (ret)
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||||
return pcibios_err_to_errno(ret);
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||||
val = cpu_to_le16(val);
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||||
if (copy_to_user(buf + count - size, &val, 2))
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return -EFAULT;
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pos += 2;
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size -= 2;
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}
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while (size > 3) {
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u32 val;
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ret = pci_user_read_config_dword(pdev, pos, &val);
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||||
if (ret)
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||||
return pcibios_err_to_errno(ret);
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||||
val = cpu_to_le32(val);
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||||
if (copy_to_user(buf + count - size, &val, 4))
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||||
return -EFAULT;
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pos += 4;
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size -= 4;
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}
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||||
while (size >= 2) {
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u16 val;
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ret = pci_user_read_config_word(pdev, pos, &val);
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||||
if (ret)
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||||
return pcibios_err_to_errno(ret);
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||||
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||||
val = cpu_to_le16(val);
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||||
if (copy_to_user(buf + count - size, &val, 2))
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||||
return -EFAULT;
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||||
pos += 2;
|
||||
size -= 2;
|
||||
}
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||||
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||||
while (size) {
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||||
u8 val;
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||||
ret = pci_user_read_config_byte(pdev, pos, &val);
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||||
if (ret)
|
||||
return pcibios_err_to_errno(ret);
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||||
|
||||
if (copy_to_user(buf + count - size, &val, 1))
|
||||
return -EFAULT;
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||||
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||||
pos++;
|
||||
size--;
|
||||
}
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||||
*ppos += count;
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return count;
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}
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static void vfio_pci_igd_cfg_release(struct vfio_pci_device *vdev,
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struct vfio_pci_region *region)
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{
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struct pci_dev *pdev = region->data;
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pci_dev_put(pdev);
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}
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static const struct vfio_pci_regops vfio_pci_igd_cfg_regops = {
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.rw = vfio_pci_igd_cfg_rw,
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.release = vfio_pci_igd_cfg_release,
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};
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static int vfio_pci_igd_cfg_init(struct vfio_pci_device *vdev)
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{
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struct pci_dev *host_bridge, *lpc_bridge;
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int ret;
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host_bridge = pci_get_domain_bus_and_slot(0, 0, PCI_DEVFN(0, 0));
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||||
if (!host_bridge)
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return -ENODEV;
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if (host_bridge->vendor != PCI_VENDOR_ID_INTEL ||
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||||
host_bridge->class != (PCI_CLASS_BRIDGE_HOST << 8)) {
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pci_dev_put(host_bridge);
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||||
return -EINVAL;
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}
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ret = vfio_pci_register_dev_region(vdev,
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PCI_VENDOR_ID_INTEL | VFIO_REGION_TYPE_PCI_VENDOR_TYPE,
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VFIO_REGION_SUBTYPE_INTEL_IGD_HOST_CFG,
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||||
&vfio_pci_igd_cfg_regops, host_bridge->cfg_size,
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||||
VFIO_REGION_INFO_FLAG_READ, host_bridge);
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if (ret) {
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pci_dev_put(host_bridge);
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return ret;
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}
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||||
lpc_bridge = pci_get_domain_bus_and_slot(0, 0, PCI_DEVFN(0x1f, 0));
|
||||
if (!lpc_bridge)
|
||||
return -ENODEV;
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||||
if (lpc_bridge->vendor != PCI_VENDOR_ID_INTEL ||
|
||||
lpc_bridge->class != (PCI_CLASS_BRIDGE_ISA << 8)) {
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||||
pci_dev_put(lpc_bridge);
|
||||
return -EINVAL;
|
||||
}
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ret = vfio_pci_register_dev_region(vdev,
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||||
PCI_VENDOR_ID_INTEL | VFIO_REGION_TYPE_PCI_VENDOR_TYPE,
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||||
VFIO_REGION_SUBTYPE_INTEL_IGD_LPC_CFG,
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||||
&vfio_pci_igd_cfg_regops, lpc_bridge->cfg_size,
|
||||
VFIO_REGION_INFO_FLAG_READ, lpc_bridge);
|
||||
if (ret) {
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||||
pci_dev_put(lpc_bridge);
|
||||
return ret;
|
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}
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|
||||
return 0;
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||||
}
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int vfio_pci_igd_init(struct vfio_pci_device *vdev)
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{
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int ret;
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ret = vfio_pci_igd_opregion_init(vdev);
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if (ret)
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return ret;
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||||
ret = vfio_pci_igd_cfg_init(vdev);
|
||||
if (ret)
|
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return ret;
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return 0;
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}
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@ -123,9 +123,9 @@ extern int vfio_pci_register_dev_region(struct vfio_pci_device *vdev,
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const struct vfio_pci_regops *ops,
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||||
size_t size, u32 flags, void *data);
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#ifdef CONFIG_VFIO_PCI_IGD
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||||
extern int vfio_pci_igd_opregion_init(struct vfio_pci_device *vdev);
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||||
extern int vfio_pci_igd_init(struct vfio_pci_device *vdev);
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||||
#else
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||||
static inline int vfio_pci_igd_opregion_init(struct vfio_pci_device *vdev)
|
||||
static inline int vfio_pci_igd_init(struct vfio_pci_device *vdev)
|
||||
{
|
||||
return -ENODEV;
|
||||
}
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@ -283,7 +283,10 @@ struct vfio_region_info_cap_type {
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#define VFIO_REGION_TYPE_PCI_VENDOR_TYPE (1 << 31)
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#define VFIO_REGION_TYPE_PCI_VENDOR_MASK (0xffff)
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/* 8086 Vendor sub-types */
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||||
#define VFIO_REGION_SUBTYPE_INTEL_IGD_OPREGION (1)
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||||
#define VFIO_REGION_SUBTYPE_INTEL_IGD_HOST_CFG (2)
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#define VFIO_REGION_SUBTYPE_INTEL_IGD_LPC_CFG (3)
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||||
/**
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* VFIO_DEVICE_GET_IRQ_INFO - _IOWR(VFIO_TYPE, VFIO_BASE + 9,
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