target-mips: add MSA 3RF format instructions
add MSA 3RF format instructions Signed-off-by: Yongbok Kim <yongbok.kim@imgtec.com> Signed-off-by: Leon Alrae <leon.alrae@imgtec.com>
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Leon Alrae
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1e608ec14e
commit
7d05b9c86f
@ -858,3 +858,45 @@ DEF_HELPER_5(msa_insve_df, void, env, i32, i32, i32, i32)
|
|||||||
DEF_HELPER_3(msa_ctcmsa, void, env, tl, i32)
|
DEF_HELPER_3(msa_ctcmsa, void, env, tl, i32)
|
||||||
DEF_HELPER_2(msa_cfcmsa, tl, env, i32)
|
DEF_HELPER_2(msa_cfcmsa, tl, env, i32)
|
||||||
DEF_HELPER_3(msa_move_v, void, env, i32, i32)
|
DEF_HELPER_3(msa_move_v, void, env, i32, i32)
|
||||||
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||||||
|
DEF_HELPER_5(msa_fcaf_df, void, env, i32, i32, i32, i32)
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||||||
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DEF_HELPER_5(msa_fcun_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fceq_df, void, env, i32, i32, i32, i32)
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||||||
|
DEF_HELPER_5(msa_fcueq_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fclt_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcult_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcle_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcule_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsaf_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsun_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fseq_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsueq_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fslt_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsult_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsle_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsule_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fadd_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsub_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmul_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fdiv_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmadd_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmsub_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fexp2_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fexdo_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_ftq_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmin_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmin_a_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmax_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fmax_a_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcor_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcune_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fcne_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_mul_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_madd_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_msub_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsor_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsune_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_fsne_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_mulr_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_maddr_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
DEF_HELPER_5(msa_msubr_q_df, void, env, i32, i32, i32, i32)
|
||||||
|
|||||||
File diff suppressed because it is too large
Load Diff
@ -17895,6 +17895,164 @@ static void gen_msa_elm(CPUMIPSState *env, DisasContext *ctx)
|
|||||||
gen_msa_elm_df(env, ctx, df, n);
|
gen_msa_elm_df(env, ctx, df, n);
|
||||||
}
|
}
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||||||
|
|
||||||
|
static void gen_msa_3rf(CPUMIPSState *env, DisasContext *ctx)
|
||||||
|
{
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||||||
|
#define MASK_MSA_3RF(op) (MASK_MSA_MINOR(op) | (op & (0xf << 22)))
|
||||||
|
uint8_t df = (ctx->opcode >> 21) & 0x1;
|
||||||
|
uint8_t wt = (ctx->opcode >> 16) & 0x1f;
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||||||
|
uint8_t ws = (ctx->opcode >> 11) & 0x1f;
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||||||
|
uint8_t wd = (ctx->opcode >> 6) & 0x1f;
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||||||
|
|
||||||
|
TCGv_i32 twd = tcg_const_i32(wd);
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||||||
|
TCGv_i32 tws = tcg_const_i32(ws);
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||||||
|
TCGv_i32 twt = tcg_const_i32(wt);
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|
TCGv_i32 tdf = tcg_temp_new_i32();
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||||||
|
|
||||||
|
/* adjust df value for floating-point instruction */
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||||||
|
tcg_gen_movi_i32(tdf, df + 2);
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||||||
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|
||||||
|
switch (MASK_MSA_3RF(ctx->opcode)) {
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||||||
|
case OPC_FCAF_df:
|
||||||
|
gen_helper_msa_fcaf_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FADD_df:
|
||||||
|
gen_helper_msa_fadd_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCUN_df:
|
||||||
|
gen_helper_msa_fcun_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSUB_df:
|
||||||
|
gen_helper_msa_fsub_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCOR_df:
|
||||||
|
gen_helper_msa_fcor_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCEQ_df:
|
||||||
|
gen_helper_msa_fceq_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMUL_df:
|
||||||
|
gen_helper_msa_fmul_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCUNE_df:
|
||||||
|
gen_helper_msa_fcune_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCUEQ_df:
|
||||||
|
gen_helper_msa_fcueq_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FDIV_df:
|
||||||
|
gen_helper_msa_fdiv_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCNE_df:
|
||||||
|
gen_helper_msa_fcne_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCLT_df:
|
||||||
|
gen_helper_msa_fclt_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMADD_df:
|
||||||
|
gen_helper_msa_fmadd_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MUL_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_mul_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCULT_df:
|
||||||
|
gen_helper_msa_fcult_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMSUB_df:
|
||||||
|
gen_helper_msa_fmsub_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MADD_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_madd_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCLE_df:
|
||||||
|
gen_helper_msa_fcle_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MSUB_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_msub_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FCULE_df:
|
||||||
|
gen_helper_msa_fcule_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FEXP2_df:
|
||||||
|
gen_helper_msa_fexp2_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSAF_df:
|
||||||
|
gen_helper_msa_fsaf_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FEXDO_df:
|
||||||
|
gen_helper_msa_fexdo_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSUN_df:
|
||||||
|
gen_helper_msa_fsun_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSOR_df:
|
||||||
|
gen_helper_msa_fsor_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSEQ_df:
|
||||||
|
gen_helper_msa_fseq_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FTQ_df:
|
||||||
|
gen_helper_msa_ftq_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSUNE_df:
|
||||||
|
gen_helper_msa_fsune_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSUEQ_df:
|
||||||
|
gen_helper_msa_fsueq_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSNE_df:
|
||||||
|
gen_helper_msa_fsne_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSLT_df:
|
||||||
|
gen_helper_msa_fslt_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMIN_df:
|
||||||
|
gen_helper_msa_fmin_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MULR_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_mulr_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSULT_df:
|
||||||
|
gen_helper_msa_fsult_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMIN_A_df:
|
||||||
|
gen_helper_msa_fmin_a_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MADDR_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_maddr_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSLE_df:
|
||||||
|
gen_helper_msa_fsle_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMAX_df:
|
||||||
|
gen_helper_msa_fmax_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_MSUBR_Q_df:
|
||||||
|
tcg_gen_movi_i32(tdf, df + 1);
|
||||||
|
gen_helper_msa_msubr_q_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FSULE_df:
|
||||||
|
gen_helper_msa_fsule_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
case OPC_FMAX_A_df:
|
||||||
|
gen_helper_msa_fmax_a_df(cpu_env, tdf, twd, tws, twt);
|
||||||
|
break;
|
||||||
|
default:
|
||||||
|
MIPS_INVAL("MSA instruction");
|
||||||
|
generate_exception(ctx, EXCP_RI);
|
||||||
|
break;
|
||||||
|
}
|
||||||
|
|
||||||
|
tcg_temp_free_i32(twd);
|
||||||
|
tcg_temp_free_i32(tws);
|
||||||
|
tcg_temp_free_i32(twt);
|
||||||
|
tcg_temp_free_i32(tdf);
|
||||||
|
}
|
||||||
|
|
||||||
static void gen_msa(CPUMIPSState *env, DisasContext *ctx)
|
static void gen_msa(CPUMIPSState *env, DisasContext *ctx)
|
||||||
{
|
{
|
||||||
uint32_t opcode = ctx->opcode;
|
uint32_t opcode = ctx->opcode;
|
||||||
@ -17929,6 +18087,11 @@ static void gen_msa(CPUMIPSState *env, DisasContext *ctx)
|
|||||||
case OPC_MSA_ELM:
|
case OPC_MSA_ELM:
|
||||||
gen_msa_elm(env, ctx);
|
gen_msa_elm(env, ctx);
|
||||||
break;
|
break;
|
||||||
|
case OPC_MSA_3RF_1A:
|
||||||
|
case OPC_MSA_3RF_1B:
|
||||||
|
case OPC_MSA_3RF_1C:
|
||||||
|
gen_msa_3rf(env, ctx);
|
||||||
|
break;
|
||||||
default:
|
default:
|
||||||
MIPS_INVAL("MSA instruction");
|
MIPS_INVAL("MSA instruction");
|
||||||
generate_exception(ctx, EXCP_RI);
|
generate_exception(ctx, EXCP_RI);
|
||||||
|
|||||||
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