Implement tick interrupt disable bits
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29
hw/sun4u.c
29
hw/sun4u.c
@ -57,6 +57,9 @@
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#define MAX_PILS 16
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#define TICK_INT_DIS 0x8000000000000000ULL
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#define TICK_MAX 0x7fffffffffffffffULL
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struct hwdef {
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const char * const default_cpu_model;
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uint16_t machine_id;
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@ -269,11 +272,14 @@ static void main_cpu_reset(void *opaque)
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CPUState *env = s->env;
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cpu_reset(env);
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ptimer_set_limit(env->tick, 0x7fffffffffffffffULL, 1);
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env->tick_cmpr = TICK_INT_DIS | 0;
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ptimer_set_limit(env->tick, TICK_MAX, 1);
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ptimer_run(env->tick, 0);
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ptimer_set_limit(env->stick, 0x7fffffffffffffffULL, 1);
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env->stick_cmpr = TICK_INT_DIS | 0;
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ptimer_set_limit(env->stick, TICK_MAX, 1);
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||||
ptimer_run(env->stick, 0);
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ptimer_set_limit(env->hstick, 0x7fffffffffffffffULL, 1);
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||||
env->hstick_cmpr = TICK_INT_DIS | 0;
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ptimer_set_limit(env->hstick, TICK_MAX, 1);
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ptimer_run(env->hstick, 0);
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env->gregs[1] = 0; // Memory start
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env->gregs[2] = ram_size; // Memory size
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@ -286,24 +292,29 @@ static void tick_irq(void *opaque)
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{
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CPUState *env = opaque;
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env->softint |= SOFTINT_TIMER;
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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||||
if (!(env->tick_cmpr & TICK_INT_DIS)) {
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env->softint |= SOFTINT_TIMER;
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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}
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}
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static void stick_irq(void *opaque)
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{
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CPUState *env = opaque;
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env->softint |= SOFTINT_TIMER;
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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if (!(env->stick_cmpr & TICK_INT_DIS)) {
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env->softint |= SOFTINT_STIMER;
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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}
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}
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static void hstick_irq(void *opaque)
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{
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CPUState *env = opaque;
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env->softint |= SOFTINT_TIMER;
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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||||
if (!(env->hstick_cmpr & TICK_INT_DIS)) {
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cpu_interrupt(env, CPU_INTERRUPT_TIMER);
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}
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}
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void cpu_tick_set_count(void *opaque, uint64_t count)
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@ -330,7 +330,8 @@ typedef struct CPUSPARCState {
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uint64_t hpstate, htstate[MAXTL_MAX], hintp, htba, hver, hstick_cmpr, ssr;
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void *hstick; // UA 2005
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uint32_t softint;
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#define SOFTINT_TIMER 1
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#define SOFTINT_TIMER 1
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#define SOFTINT_STIMER (1 << 16)
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#endif
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sparc_def_t *def;
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} CPUSPARCState;
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