target/tricore: Implement privilege level for all insns
Reviewed-by: Richard Henderson <richard.henderson@linaro.org> Signed-off-by: Bastian Koppelmann <kbastian@mail.uni-paderborn.de> Message-Id: <20230621142302.1648383-7-kbastian@mail.uni-paderborn.de>
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57b9c589b6
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@ -388,7 +388,7 @@ static inline void gen_mtcr(DisasContext *ctx, TCGv r1,
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}
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}
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} else {
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/* generate privilege trap */
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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}
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@ -3375,7 +3375,11 @@ static void decode_sc_opc(DisasContext *ctx, int op1)
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tcg_gen_andi_tl(cpu_gpr_d[15], cpu_gpr_d[15], const16);
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break;
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case OPC1_16_SC_BISR:
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gen_helper_1arg(bisr, const16 & 0xff);
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if (ctx->priv == TRICORE_PRIV_SM) {
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gen_helper_1arg(bisr, const16 & 0xff);
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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break;
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case OPC1_16_SC_LD_A:
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gen_offset_ld(ctx, cpu_gpr_a[15], cpu_gpr_a[10], const16 * 4, MO_LESL);
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@ -5236,7 +5240,11 @@ static void decode_rc_serviceroutine(DisasContext *ctx)
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switch (op2) {
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case OPC2_32_RC_BISR:
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gen_helper_1arg(bisr, const9);
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if (ctx->priv == TRICORE_PRIV_SM) {
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||||
gen_helper_1arg(bisr, const9);
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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break;
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case OPC2_32_RC_SYSCALL:
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generate_trap(ctx, TRAPC_SYSCALL, const9 & 0xff);
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@ -7890,20 +7898,33 @@ static void decode_sys_interrupts(DisasContext *ctx)
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/* raise EXCP_DEBUG */
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break;
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case OPC2_32_SYS_DISABLE:
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tcg_gen_andi_tl(cpu_ICR, cpu_ICR, ~ctx->icr_ie_mask);
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if (ctx->priv == TRICORE_PRIV_SM || ctx->priv == TRICORE_PRIV_UM1) {
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||||
tcg_gen_andi_tl(cpu_ICR, cpu_ICR, ~ctx->icr_ie_mask);
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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break;
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case OPC2_32_SYS_DISABLE_D:
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if (has_feature(ctx, TRICORE_FEATURE_16)) {
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tcg_gen_extract_tl(cpu_gpr_d[r1], cpu_ICR, ctx->icr_ie_offset, 1);
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||||
tcg_gen_andi_tl(cpu_ICR, cpu_ICR, ~ctx->icr_ie_mask);
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||||
if (ctx->priv == TRICORE_PRIV_SM || ctx->priv == TRICORE_PRIV_UM1) {
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||||
tcg_gen_extract_tl(cpu_gpr_d[r1], cpu_ICR,
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||||
ctx->icr_ie_offset, 1);
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||||
tcg_gen_andi_tl(cpu_ICR, cpu_ICR, ~ctx->icr_ie_mask);
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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} else {
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generate_trap(ctx, TRAPC_INSN_ERR, TIN2_IOPC);
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}
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case OPC2_32_SYS_DSYNC:
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break;
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case OPC2_32_SYS_ENABLE:
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tcg_gen_ori_tl(cpu_ICR, cpu_ICR, ctx->icr_ie_mask);
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ctx->base.is_jmp = DISAS_EXIT_UPDATE;
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if (ctx->priv == TRICORE_PRIV_SM || ctx->priv == TRICORE_PRIV_UM1) {
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||||
tcg_gen_ori_tl(cpu_ICR, cpu_ICR, ctx->icr_ie_mask);
|
||||
ctx->base.is_jmp = DISAS_EXIT_UPDATE;
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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}
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||||
break;
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case OPC2_32_SYS_ISYNC:
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||||
break;
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@ -7931,7 +7952,7 @@ static void decode_sys_interrupts(DisasContext *ctx)
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gen_set_label(l1);
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||||
ctx->base.is_jmp = DISAS_EXIT;
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} else {
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/* generate privilege trap */
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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||||
}
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||||
break;
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||||
case OPC2_32_SYS_RSLCX:
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@ -7944,7 +7965,9 @@ static void decode_sys_interrupts(DisasContext *ctx)
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if (has_feature(ctx, TRICORE_FEATURE_16)) {
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||||
if (ctx->priv == TRICORE_PRIV_SM || ctx->priv == TRICORE_PRIV_UM1) {
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tcg_gen_deposit_tl(cpu_ICR, cpu_ICR, cpu_gpr_d[r1], 8, 1);
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} /* else raise privilege trap */
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} else {
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generate_trap(ctx, TRAPC_PROT, TIN1_PRIV);
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||||
}
|
||||
} else {
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||||
generate_trap(ctx, TRAPC_INSN_ERR, TIN2_IOPC);
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}
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